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저 SNR 레이더 인식을 위한 FPGA 실시간 구현 및 경량 모델 설계 featured image

저 SNR 레이더 인식을 위한 FPGA 실시간 구현 및 경량 모델 설계

저 SNR 레이더 신호의 실시간 처리를 위해 RFNoC/FPGA 검출·분류 체인을 구현하고, Cross-Resolution KD로 경량 분류 모델을 설계한 연구입니다.

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레이더 신호 검출 및 제원 추정

저 SNR 환경에서 펄스를 검출하고 시간·주파수 구조를 복원해 레이더 신호의 주요 제원을 추정한 연구입니다.